2021年5月10日 星期一

HBLbits_Verilog Basic_Sim/circuit4

HBLbits_Verilog Basic_Sim/circuit4

This is a combinational circuit. Read the simulation waveforms to determine what the circuit does, then implement it.






module top_module (
    input a,
    input b,
    input c,
    input d,
    output q );//
    assign q = b|c; // Fix me
endmodule

沒有留言:

張貼留言

Cargo Transfer Process Simulation 「貨物轉移過程模擬」

Cargo Transfer Process Simulation「貨物轉移過程模擬」 https://www.youtube.com/watch?v=Ic9PpPG-_NU   以下是操作步驟: 打開 EasyBuilder Pro,選擇「新建專案」(New Project),...